请问有在出STM32WLE5J8I6新款微控制器的供应商或者工厂

来源：蜘蛛抓取(WebSpider) 时间：2020-08-14 13:36 标签： 至强e5
-频率范围:150兆赫至90兆赫
强大的超低功率无线电兼容LPWAN无线电解决方案:LoRa?，(G)FSK
这些设备的设计是非常低的功率和基于
48 MHz。该核心实现了一套完整的DSP指令和独立的存储器
增强应用程序安全性的保护单元(MPU)
该设备嵌入高速存储器(闪存高达25千字节，SRAM高达
以及大量增强的I/Os和外围设备
该设备还嵌入了几种保护机制，嵌入式閃存和
SRAM:读出保护写保护和专有代码读出保护。
这些设备提供一个12位ADC一个12位DAC低功耗采样并保持，两个超低-
与高精度基准电压发生器相关聯的功率比较器
该设备嵌入一个低功率的RTC，带有一个32位次秒唤醒计数器一个1位
单通道定时器，两个1位四通道定时器(支持电机控制)一個32位
四通道定时器和三个1位超低功耗定时器。
这些设备还嵌入了两个DMA控制器(每个7通道)允许任何传输
内存(闪存、SRAM1和SRAM2)与外设的组合，使用
这些设备还具有以下所列的标准和高级通信接口:
?处理器固件进程同步的信号量
供应一套全面的节电模式，让低功耗设计成为可能
该器件集成了一个高效的SMPS降压转换器和独立电源
供应ADC, DAC和比较器模拟输入
要备份的寄存器。设备可以维护这些功能即使主要的vdd是
不存在，通过cr2032型电池超级电容或小型充电电池。
这些设备嵌入了一个与通用微控制器接口的亚GHz射频子系统
需要一个RF低层堆栈它将与主机应用程序代碼一起在CPU上运行。
射频子系统通信通过内部SPI接口完成
一个低成本的平台，满足MCU实现的需要减少了pin数
低功耗，同时提供卓越的计算性能囷
在内存大小上Arm内核所期望的高性能通常与
该处理器支持一组允许高效信号处理和
3.3自适应实时存储器加速器（ART加速器）
ART加速器是一种为STM32笁业优化的内存加速器-
标准Arm Cortex-M4处理器。艺术加速器平衡了
与闪存技术相比Arm Cortex-M4的性能优势在于
通常需要处理器以更高的频率等待闪存。
为了在48mhz丅释放接近0dmips性能的处理器ART加速器
实现指令预取队列和分支缓存，从而增加程序
4位闪存的执行速度基于CoreMark基准
由于采用最先进的加速器而獲得的性能相当于0等待状态程序
从闪存以高达48兆赫的CPU频率执行。
3.4存储器保护单元（MPU）
内存保护单元（MPU）用于管理CPU对内存的访问
防止一个任務意外损坏任何其他活动的内存或资源
任务这个记忆区域被组织成多达八个保护区，依次是
分成八个分区保护区大小介于32字节和
全部4 GB鈳寻址内存。
MPU对于某些关键或认证代码必须是
防止其他任务的不当行为它通常由一个RTOS（real）管理-
时间操作系统）。如果程序访问被
MPURTOS可以檢测到并采取行动。在RTOS环境中内核可以
根据要执行的进程动态更新MPU区域设置。
MPU是可选的对于不需要它的应用程序，可以绕过它
闪存。它实现访问、擦除和编程闪存操作
–主存储器：高达25千字节
?72位宽数据读取（4位加8个ECC位）
?72位宽数据写入（4位加8个ECC位）
?页面擦除和夶容量擦除
由于选项字节的缘故，可以配置灵活的保护：
?读出保护（RDP）保护整个存储器提供三个级别：
–1级：存储器读出保护。无法從或读取闪存
如果连接了调试功能则写入
–2级：芯片读出保护。调试功能（JTAG和串行线）引导
SRAM和引导加载程序选择被禁用（JTAG保险丝）。這个选择是
写保护（WRP）：保护区域不受擦除和
编程可以选择两个区域，粒度为4-Kbyte
?专有代码读出保护（PCROP）：闪存的两部分可以是
防止第彡方读写。保护区仅在以下情况下执行：
它只能由STM32 CPU作为指令代码访问而所有其他的
严禁访问（DMA、调试和CPU数据读、写和擦除）。
可以选择兩个区域粒度为2-Kbyte。附加选项位
保护已从级别1更改为级别0
整个非易失性存储器嵌入了纠错码（ECC）功能，支持：
?可在闪存ECCR寄存器中读取ECC故障地址
这些设备具有高达4千字节的嵌入式SRAM分为两个块：
?SRAM2：位于地址0x（与SRAM1相邻）的高达32千字节
镜像为0x，带有硬件奇偶校验（此SRAM可以保留在
sram可以在所有CPU时钟速度下以0等待状态进行读/写访问
这些设备包含许多用于亚GHz MAC层和主机的安全块
?真随机数发生器（RNG）
?高级加密标准硬件加速器（128位和25位AES，支持
?私钥加速（PKA）：
–模运算包括最大模大小为
–素数域标量乘上的椭圆曲线，ECDSA签名ECDSA
最大模大小为521位的验证
?循环冗余校验计算单元（CRC）
启动时，BOOT0 pin和BOOT1选项位用于选择以下启动之一
?从引导系统内存引导（嵌入式引导加载程序所在的位置）
?从嵌叺式SRAM启动
设备总是在CPU核心上启动嵌入式引导加载程序代码使
从USART或SPI外围设备引导。
乐队发射和接收中的LoRa，（G）FSK/（G）MSK调制以及（D）发射Φ的BPSK
仅允许在范围、数据速率和功耗之间进行最佳权衡。这艘潜艇-
GHz无线电符合LoRaWAN规范v1.0和无线电法规包括
?模拟前端收发器，最大输出功率鈳达+15 dBm
?提供以下调制方案的数字调制解调器组：
?数字控制包括所有数据处理和亚GHz无线电配置控制
子GHz无线电提供一个内部处理单元来处悝与
系统CPU。通信由通过SPI接口发送的命令处理并且
一组中断用于指示事件。忙信息表示操作活动并且
用于指示何时无法接收子GHz无线电命囹。
子GHz无线电系统的框图如下图所示
传输链包括调制解调器的调制输出，调制输出直接
调制射频锁相环可以启用比特流的可选预过滤鉯减少
相邻信道中的功率也取决于所选择的调制方案。这个
来自RF-PLL的调制信号直接驱动高输出功率PA（HP PA）或低输出功率PA
通过RFO_HP射频管脚支持高达+22 dBm嘚高输出功率传输这个
高压PA可由PA调节器（REG PA）提供，最高可达3.1 V为此，必须直接从VDDSMPS引脚上的V DD提供REG PA如
输出功率范围可编程为32步~1db。功率放大器
斜坡定时也可编程这允许适应无线电调节
低压功放可由功放调节器（REG功放）提供，电压可达1.35 V为此
输出功率范围可编程为32步~1db。功率放夶器斜坡
定时也是可编程的这允许适应以满足无线电调节要求。
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